Verilog MCP Server

Name: Verilog MCP Server
Author: kaiwenyu147369

@kaiwenyu147369

Verilog MCP Server について

Generate Verilog testbenches, lint RTL code (7 rules), and scaffold UVM verification environments — directly inside Claude Code via MCP.

#verilog #systemverilog #chip-design #eda #uvm #mcp #claude-code #hardware

基本情報

カテゴリ

開発者ツール

トランスポート

stdio

公開者

kaiwenyu147369

投稿者

Kaiwen Yu

設定

以下の設定を使って、このサーバーを MCP 対応クライアントに追加してください。

{
  "mcpServers": {
    "verilog-mcp-server": {
      "command": "python",
      "args": [
        "server.py"
      ]
    }
  }
}

ツール

ツールは検出されませんでした

ツールは README から自動的に抽出されます。メンテナーは ## Tools という見出しの下に記載することで、このタブに反映できます。

概要

What is Verilog MCP Server?

Verilog MCP Server is an MCP (Model Context Protocol) server that provides three tools for Verilog hardware design and verification: testbench generation, static lint checking, and UVM environment generation. It is

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